半導體光刻新變局,日本DNP光刻技術,能否撕開ASML壟斷缺口?

2025年12月18日23:52:07 科學 1458

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全球半導體圈最近都在聊一個事,日本印刷株式會社(DNP)突然宣布,搞出了10納米線寬的納米壓印光刻掩膜版,理論上能支持1.4納米邏輯芯片的製造。

要知道現在最先進的光刻技術,基本被ASML極紫外光刻(EUV)壟斷着,先進制程的廠子想買EUV還得排隊,這消息一出,不少人說可能要變天了。

光刻技術是芯片製造的「眼睛」,沒有它就刻不出納米級的電路。

現在最牛的EUV,是ASML花了幾十年搞出來的寶貝,一台設備十幾億,還得配專門的廠房,恆溫恆濕防震動,伺候起來比祖宗還難。

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但它精度高啊,能做2納米、1.4納米的芯片,全球頂尖晶圓廠都搶着要。

突然冒出來的納米壓印光刻,走的是另一條路。

簡單說,EUV是用極紫外光當「筆」,在硅片上「畫」電路,納米壓印更像「蓋章」,先做個超精密的模板,上面刻好電路圖案。

然後往硅片上塗層特殊膠,把模板蓋上去壓一下,紫外光一照固化,圖案就印上去了,聽着是不是比EUV簡單多了?

從「蓋章」到「畫畫」,兩種光刻技術的硬碰硬

EUV的原理說起來複雜,實際用起來更複雜。

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它得在真空環境里工作,光源是用高功率激光轟擊熔融的錫滴,產生波長13.5納米的極紫外光,再通過十幾塊超精密的反射鏡聚焦,才能在硅片上「畫」出電路。

就這一套設備,每年電費就得幾百萬美元,一般小廠子根本玩不起。

ASML也知道自己壟斷,所以EUV不是有錢就能買。

前幾年我們想引進,人家直接說「不賣」,理由是「出口管制」。

這就導致現在全球先進制程的產能,基本被台積電三星英特爾這幾家握着,他們手裡有EUV,別人就只能眼巴巴看着。

納米壓印的思路就簡單粗暴多了,沒有複雜的光學系統,不用真空環境,主要靠機械壓印和紫外固化。

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DNP這次突破的掩膜版技術,就是把模板的精度提到了10納米線寬,按行業算法,差不多能對應1.4納米的芯片製程。

這可不是實驗室里的樣品,人家說已經能穩定生產掩膜版了。

最吸引人的還是成本和能耗,日經新聞之前算過一筆賬,納米壓印的能耗大概是EUV的十分之一,製造成本能降近四成。

對那些沒能力買EUV的晶圓廠來說,這吸引力太大了。

比如一些做存儲芯片的廠子,或者想搞先進制程但被卡脖子的地區,說不定會願意試試水。

實驗室到產線,納米壓印的三道坎

但技術好不一定就能落地,尤其是芯片製造這種需要全產業鏈配合的事。

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第一個坎,就是模板的壽命和維護。

納米壓印的模板得達到原子級精度,上面哪怕有個頭髮絲萬分之一大小的缺陷,壓印幾萬次後,缺陷就會擴散到整片晶圓,良率直接崩掉。

DNP說解決了掩膜版技術,但模板能用多少次,壞了怎麼修,這些都得量產了才知道。

第二個坎,是套刻精度。

現在的芯片不是一層電路,而是幾十層疊在一起,每層圖案都得對準,誤差不能超過幾納米。

EUV靠光學系統非接觸對準,精度很穩定,納米壓印是機械接觸,壓印時硅片和模板難免有微小變形,疊幾十層後,誤差可能就累積到沒法用了。

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這就像蓋郵戳,蓋一張容易,蓋一百張每張都對齊,難。

第三個坎,是產能。

ASML的EUV單台設備每小時能處理150片以上晶圓,良率穩定在99%以上。

納米壓印雖然單次壓印快,但換模板、校準對準、檢查缺陷都耗時,目前實驗室數據顯示,產能可能只有EUV的一半。

對晶圓廠來說,產能就是錢,慢一步可能就被競爭對手甩開了。

市場接受度也是個大問題,佳能2023年就推出過商用納米壓印設備,吹能做5納米製程,結果2024年交付了幾台給研究所,主流晶圓廠沒一家敢把它放進量產線。

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台積電、三星現在還在砸錢買ASML的下一代高數值孔徑EUV,產業鏈上下游都圍着EUV建生態,設計軟件、光刻膠、檢測設備全是為EUV定製的。

想換技術路線,等於把整條產業鏈推倒重來。

日本搞納米壓印,其實有點「曲線救國」的意思。

上世紀80年代,日本半導體佔全球半壁江山,後來被美國打壓,加上自己路線保守,慢慢掉隊了。

現在ASML壟斷EUV,日本想靠納米壓印這種「非主流」技術找突破口,政府還給了不少補貼,DNP這次突破,背後就有日本半導體振興計劃的影子。

咱們這邊也在關注納米壓印,畢竟EUV拿不到,先進制程總得想辦法。

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2025年國內已經交付了首台國產納米壓印設備,三百多家企業在相關領域研發,重點在NAND閃存、邏輯芯片非關鍵層這些場景試水。

不求一步到位替代EUV,先在特定領域用起來,積累經驗再說。

DNP這技術突破確實讓人眼前一亮,但要說能馬上撕開EUV的壟斷缺口,怕是有點樂觀了。

ASML也不是吃素的,下一代高數值孔徑EUV已經在測試,2025年就能量產,精度能到0.7納米。

納米壓印想真正威脅到EUV,至少還得解決量產良率、產能和產業鏈協同這幾個問題。

不過多一條技術路線總是好的,ASML壟斷帶來的「單點風險」一直存在,2021年它設備交付延期,直接導致台積電先進制程爬坡慢了三個月。

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要是納米壓印能在存儲芯片、低功耗邏輯芯片這些領域站穩腳跟,至少能讓半導體產業鏈多一個選擇,不用再把所有雞蛋放EUV一個籃子里。

現在業內最關心的是DNP接下來的動作,他們說2025年要在SEMICONJapan展會上展示實際應用案例,到時候就能看看這技術到底是「真突破」還是「實驗室樣品」。

要是真能穩定量產,哪怕只在特定領域用,對半導體產業來說,也算多了條活路。

說到底,技術競爭從來不是一蹴而就的。

EUV從研發到商用花了二十年,納米壓印想走到台前,估計也得經歷這個過程。

但至少現在,有人敢對壟斷說「不」,這本身就值得關注。

畢竟芯片製造這行當,多一個玩家,多一種技術,對整個行業都是好事。

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